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Mealy机

实验二十二MEAL Y机

一、实验目的

1、对于图22-1所示的状态图和状态机框图,将其实现为Mealy型状态机,输出信号是否

存在“毛刺”没有要求,写出其VHDL源代码(包括entity和architecture)并画出结果电路图,要求调试通过。

2、重新完成第一个内容,要求输出信号没有“毛刺”。

3、对于图22-1所示的状态图和状态机框图,写出其VHDL源代码(包括entity和

architecture)并画出结果电路图,要求调试通过,输出信号没有“毛刺”。

二、实验内容

In=‘1/out=‘1in=‘0’/out=‘0’

Mealy机

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图22-1

In=‘1’/out_b=‘0’

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out_a(1:0)

out_b

图22-2状态二

Medly型状态机和其等价的Moore型状态机相比,其输出变化要领先一个时钟周期。下面我们以一个实例来介绍Mealy机的设计过程。状态图和状态框图分别见图22-3和图22-4。如图22-3所示,Mealy机的输出既和当前状态有关,又和所有输入信号有关。

也就是说,一旦输入信号发生变化或状态发生变化,输出信号立即发生变化,因此在状

态图中,一般把输出信号值画在状态变迁处。例如:假定当前状态为S0,当输入信号为‘1’时,输出信号为“1001”;当输入信号不是‘1’时,输出信号为“0000”。

构造Mealy机的方法和Moore机的相同,唯一的区别是:组合进程中的输出信号是当前状态和当前输入的函数。

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输入输出信号仿真波形如下图22-5:

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三、实验连线

同前面实验,输入时钟信号接时钟电路的相应输出(CLK0~CLK5),复位信号接拨码开关或按键,输出信号接发光二极管。