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蔡觉平老师西电Verilog HDL上机大作业(硬件描述语言)_微电子学院

《Verilog HDL 数字集成电路设计原理与应用》上机作业

班级:******* 学号:******* 姓名:*******

题目1:数字集成电路的verilog HDL 描述与仿真。 要求:(1)学习使用Modelsim 设计和仿真软件; (2)练习教材7.2.1中的例子;

(3)掌握设计代码和测试代码的编写; (4)掌握测试仿真流程;

(5)掌握Modelsim 软件的波形验证方式。

解答:

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题目2: 简述begin-end 语句块和fork-join 语句块的区别,并写出下面信号对应的程序代码

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