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触发器练习题

一、填空题

1、触发器具有个稳定状态，在输入信号消失后，它能保持。

2、在基本RS 触发器中，输入端D R 或D R 能使触发器处于状态，输入端

D S 或D S 能使触发器处于状态。 3、同步RS 触发器状态的改变是与信号同步的。

4、在CP 脉冲和输入信号作用下，JK 触发器能够具有、、、和的逻辑功能。

5、对于JK 触发器，当CP 脉冲有效期间，若J=K=0时，触发器状态；若K J =时，触发器或；若J=K=1时，触发器状态。

6、与主从触发器相比，触发器的抗干扰能力较强。

7、对于JK 触发器，若J=K ，则可完成触发器的逻辑功能。

8、对于JK 触发器，若K J =，则可完成触发器的逻辑功能。

二、判断题

1、触发器有两个稳定状态，一个是现态，一个是次态。（）

2、触发器有两个稳定状态，在外界输入信号的作用下，可以从一个稳定状态转变为另一个稳定状态。（）

4、同步D 触发器的Q 端和D 端的状态在任何时刻都是相同的。（）

5、同一逻辑功能的触发器，其电路结构一定相同。（）

6、仅具有反正功能的触发器是T 触发器。（）

三、选择题

1、对于触发器和组合逻辑电路，以下（）的说法是正确的。

A 、两者都有记忆能力

B 、两者都无记忆能力

C 、只有组合逻辑电路有记忆能力

D 、只有触发器有记忆能力

2、对于JK 触发器，输入J=0、K=1，CP 脉冲作用后，触发器的1+n Q 应为（）。

A 、0

B 、1

C 、可能是0，也可能是1

D 、与n Q 有关

3、JK 触发器在CP 脉冲作用下，若使n n Q Q =+1，则输入信号应为（）。

A 、1==K J

B 、Q K Q J ==,

C 、Q K Q J ==,

D 、0==K J

4、具有“置0” “置1” “保持” “翻转”功能的触发器叫（）。

A 、JK 触发器

B 、基本RS 触发器

C 、同步

D 触发器 D 、同步RS 触发器

5、边沿控制触发的触发器的触发方式为（）。

A 、上升沿触发

B 、下降沿触发

C 、可以是上升沿触发，也可以是下降沿触发

D 、可以是高电平触发，也可以是低电平触发

6、仅具有“保持”“翻转”功能的触发器叫（）。

A 、JK 触发器

B 、RS 触发器

C 、

D 触发器 D 、T 触发器

四、简答题

1、画出用边沿JK 触发器实现边沿T 触发器的逻辑图。

5、已知同步D 触发器的输入信号波形，画出输出Q 端信号波形。

6、已知主从JK 触发器J 、K 的波形如图所示，画出输出Q 的波形图（设初始状态为0）。

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集成触发器及其应用电路设计

华中科技大学电子线路设计、测试与实验》实验报告实验名称：集成运算放大器的基本应用院（系）：自动化学院地点：南一楼东306 实验成绩：指导教师：汪小燕 2014 年6 月7 日

、实验目的 1）了解触发器的逻辑功能及相互转换的方法。 2）掌握集成JK 触发器逻辑功能的测试方法。 3）学习用JK 触发器构成简单时序逻辑电路的方法。 4）熟悉用双踪示波器测量多个波形的方法。（5）学习用Verliog HDL描述简单时序逻辑电路的方法，以及EDA技术、实验元器件及条件双JK 触发器CC4027 2 片；四2 输入与非门CC4011 2 片；三3 输入与非门CC4023 1 片；计算机、MAX+PLUSII 10.2集成开发环境、可编程器件实验板及专用电缆三、预习要求（1）复习触发器的基本类型及其逻辑功能。（2）掌握D触发器和JK触发器的真值表及JK触发器转化成D触发器、T触发器、T 触发器的基本方法。（3）按硬件电路实验内容（4）（5），分别设计同步3 分频电路和同步模4 可逆计数器电路。四、硬件电路实验内容（1）验证JK触发器的逻辑功能。（2）将JK触发器转换成T触发器和D触发器，并验证其功能。（3）将两个JK触发器连接起来，即第二个JK触发器的J、K端连接在一起，接到第一个JK触发器的输出端Q两个JK触发器的时钟端CP接在一起，并输入1kHz 正方波，用示波器分别观察和记录CP Q、Q的波形（注意它们之间的时序关系），理解2分频、4分频的概念。（4）根据给定的器件，设计一个同步3分频电路，其输出波形如图所示。然后组装电路，并用示波器观察和记录CP Q、Q的波形。（5）根据给定器件，设计一个可逆的同步模4 计数器，其框图如图所示。图中，M为控制变量，当M=0时，进行递增计数，当M=1时，进行递减计数；Q、 Q为计数器的状态输出，Z为进位或借位信号。然后组装电路，并测试电路的输入、输出

期末考试试卷_1_

职中东校区2014年下期高二电子技术试卷姓名：学号：班级：得分：一、填空题（每空2分，共82分） 1. 逻辑代数的三种基本逻辑运算是、和，在电路上，分别用门、门和门来实现。 2. 逻辑变量和逻辑函数的取值只有和两种可能。 3. 逻辑函数的表示方法有、、、、五种。 4. 101ABC =时，函数C B AB Y +=之值为Y = 。 5. 在二-十进制码中，1位十进制数用位二进制码表示，8421BCD 码从高位到低位的权值依次为。 6.（93）10=（）2，（93）10=（）8421BCD 7. 编码器的功能是将输入信号转化为。 8．JK 触发器具有、、和的功能。 9. 对于时序逻辑电路来说，某一时刻电路的输出不仅取决于当时的，而且还取决于电路。所以时序电路具有功能。 10. 用来累计和寄存输入脉冲数目的部件称为。 11. 寄存器可分成寄存器和寄存器。 12. 在计数器中，当计数脉冲输入时，所有触发器同时翻转，即各触发器状态的改变是同时进行的，这种计数器称为。 13. 施密特触发器有个稳态，单稳态触发器有个稳态，

多谐振荡器有个稳态。 14. 施密特触发器的主要用有、、、等。 15.将模拟信号转换为数字信号，需要经过、、、四个步骤。二、选择题（每空3分，共60分） 1. 下列几种逻辑门中，能用作反相器的是。 A. 与门 B. 或门 C. 与非门 2. 以下各种接法不正确的是。 A. 与非门闲置输入端接1 B. 或非门闲置输入端接地 C. TTL 与非门闲置输入端悬空 D. CMOS 门闲置输入端悬空 3. Y ABC AC BC =++，当1A C ==时，。 A. Y B = B. B Y = C. 0=Y D. 1=Y 4. 3个逻辑变量的取值组合共有种。 A. 3 B. 6 C. 8 D. 16 5. 下列逻辑函数属于与非式的是。 A. Y AB = B. Y AB = C. Y ABC = D. Y ABC = 6. 与++AB AC BC 相等的式子是。 A. +AB C B. +AB AC C. +AB BC D. +AB AB 7. 组合逻辑电路通常由组成。 A. 门电路 B. 编码器 C. 译码器 D. 数据选择器 8.优先编码器同时有两个或两个以上信号输入时，是按给输入

触发器自测练习与习题

第5章触发器 RS触发自测练习 1．或非门构成的基本RS触发器的输入S=1、R=0，当输入S变为0时，触发器的输出将会（）。（a）置位（b）复位（c）不变 2．与非门构成的基本RS触发器的输入S=1，R=1，当输入S变为0时，触发器输出将会（）。（a）保持（b）复位（c）置位 3．或非门构成的基本RS触发器的输入S=1，R=1时，其输出状态为（）。（a）Q=0，Q=1 （b）Q=1，Q=0 （c）Q=1，Q=1 （d）Q=0，Q=0 （e）状态不确定 4．与非门构成的基本RS触发器的输入S=0，R=0时，其输出状态为（）。（a）Q=0，Q=1 （b）Q=1，Q=0 （c）Q=1，Q=1 （d）Q=0，Q=0 （e）状态不确定 5．基本RS触发器74LS279的输入信号是（）有效。（a）低电平（b）高电平 6．触发器引入时钟脉冲的目的是（）。（a）改变输出状态（b）改变输出状态的时刻受时钟脉冲的控制。 7．与非门构成的基本RS触发器的约束条件是（）。（a）S+R=0 （b）S+R=1 （c）SR=0 （d）SR=1 8．钟控RS触发器的约束条件是（）。（a）S+R=0 （b）S+R=1 （c）SR=0 （d）SR=1 9．RS触发器74LS279中有两个触发器具有两个S输入端，它们的逻辑关系是（）。（a）或（b）与（c）与非（d）异或 10．触发器的输出状态是指（）。（a） Q （b）Q 答案：1．c 2．c 3．e

4．e 5．A 6．b 7．b 8．c 9．b 10．a D触发器自测练习 1．要使电平触发D触发器置1，必须使D=（）、CP=（）。 2．要使边沿触发D触发器直接置1，只要使S D＝（）、R D＝（）即可。 3．对于电平触发的D触发器或D锁存器，（）情况下Q输出总是等于D输入。 4．对于边沿触发的D触发器，下面（）是正确的。（a）输出状态的改变发生在时钟脉冲的边沿（b）要进入的状态取决于D输入（c）输出跟随每一个时钟脉冲的输入（d）（a）（b）和（c） 5．“空翻”是指（）。（a）在脉冲信号CP=1时，输出的状态随输入信号的多次翻转（b）输出的状态取决于输入信号（c）输出的状态取决于时钟和控制输入信号（d）总是使输出改变状态 6．对于74LS74，D输入端的数据在时钟脉冲的（）（上升，下降）边沿被传输到（）（, Q Q）。 7．要用边沿触发的D触发器构成一个二分频电路，将频率为100Hz的脉冲信号转换为50Hz 的脉冲信号，其电路连接形式为（）。答案：1．1，1 2．0，1 3．CP=1 4．．a 6．上升,Q 7． JK触发器自测练习 1．主从JK触发器是在（）采样，在（）输出。 2．JK触发器在（）时可以直接置1，在（）时可以直接清0。3．JK触发器处于翻转时输入信号的条件是（）（a） J=0，K=0 （b）J=0，K=1 （c） J=1，K=0 （d）J=1，K=1

江苏中职触发器练习题

一、填空题 1. 基本RS触发器，当R、S都接高电平时，该触发器具有____ ___功能。 2．D 触发器的特性方程为___ ；J-K 触发器的特性方程为______。 3．T触发器的特性方程为。 4．仅具有“置0”、“置1”功能的触发器叫。 5．时钟有效边沿到来时，输出状态和输入信号相同的触发器叫____ _____。 6. 若D触发器的D端连在Q端上，经100 个脉冲作用后，其次态为0，则现态应为。7．JK触发器J与K相接作为一个输入时相当于触发器。 8. 触发器有个稳定状态，它可以记录位二进制码，存储8 位二进制信息需要个触发器。 9．时序电路的次态输出不仅与即时输入有关，而且还与有关。 10. 时序逻辑电路一般由和两部分组成的。 11. 计数器按内部各触发器的动作步调，可分为___ ____计数器和____ ___计数器。 12. 按进位体制的不同，计数器可分为计数器和计数器两类；按计数过程中数字增减趋势的不同，计数器可分为计数器、计数器和计数器。13．要构成五进制计数器，至少需要级触发器。 14．设集成十进制（默认为8421码）加法计数器的初态为Q4Q3Q2Q1＝1001，则经过5个CP脉冲以后计数器的状态为。 15．欲将某时钟频率为32MHz的CP变为16MHz的CP，需要二进制计数器个。 16. 在各种寄存器中，存放N位二进制数码需要个触发器。 17. 有一个移位寄存器，高位在左，低位在右，欲将存放在该移位寄存器中的二进制数乘上十进制数4，则需将该移位寄存器中的数移位，需要个移位脉冲。 18．某单稳态触发器在无外触发信号时输出为0态，在外加触发信号时，输出跳变为1态，因此其稳态为态，暂稳态为态。 19．单稳态触发器有___ _个稳定状态，多谐振荡器有_ ___个稳定状态。 20．单稳态触发器在外加触发信号作用下能够由状态翻转到状态。 21．集成单稳态触发器的暂稳维持时间取决于。 22. 多谐振荡器的振荡周期为T=tw1+tw2，其中tw1为正脉冲宽度，tw2为负脉冲宽度，则占空比应为_______。

触发器试卷练习题

触发器单元测试试卷班级：姓名: 得分：一、填空题：（20分） 1. 触发器有两个输出端_______和________，正常工作时两端的状态互补，以_________端的状态表示触发器的状态。 2. 按结构形式的不同，RS 触发器可分为两大类：一类是没有时钟控制的____________触发器,另一类是具有时钟控制端的__________触发器。 3. 按逻辑功能划分，触发器可以分为________触发器、 ___________触发器、__________触发器和________触发器四种类型。 4. 钟控触发器也称同步触发器，其状态的变化不仅取决于 ___________信号的变化，还取决于___________信号的作用。 5. 钟控触发器按结构和触发方式分，有电位触发器、_________触发器、_________触发器和主从触发器四种类型。 6. 在CP 脉冲和输入信号作用下,JK 触发器能够具有______ 、 _________ 、____________ 和_____________ 的逻辑功能. 7. 在CP 脉冲和输入信号作用下,D 触发器能够具有______ 和 _____________ 的逻辑功能. 8. 边沿控制触发的触发器的触发方式为有( )、（）两种。二、选择题：（20分） 1.能够存储 0、1 二进制信息的器件是（） A.TTL 门 B.CMOS 门 C.触发器 D.译码器 2.触发器是一种（）Ａ．单稳态电路Ｂ. 无稳态电路Ｃ. 双稳态电路Ｄ. 三稳态电路 3.用与非门构成的基本RS 触发器处于置 1 状态时，其输入信号 S 、R 应为（） A.00=S R Ｂ.01=S R C.10=S R D. 11=S R 4.用与非门构成的基本RS 触发器，当输入信号 S = 0、R = 1 时，其逻辑功能为( ) A.置1 B.置0 C.保持 D.不定 5.下列触发器中，输入信号直接控制输出状态的是（） A ．基本RS 触发器 B. 钟控RS 触发器 C. 主从JK 触发器 D. 维持阻塞D 触发器

第五章练习题

第五章集成触发器练习题一、选择题 1.N个触发器可以构成能寄存位二进制数码的寄存器。 A.N-1 B.N C.N+1 D.2N 2．在下列触发器中，有约束条件的是。 A.主从JK F/F B.主从D F/F C.同步RS F/F D.边沿D F/F 3．一个触发器可记录一位二进制代码，它有个稳态。 A.0 B.1 C.2 D.3 E.4 4．存储8位二进制信息要个触发器。 A.2 B.3 C.4 D.8 5．对于T触发器，若原态Qn=0，欲使新态Qn+1=1，应使输入T= 。 A.0 B.1 C.Q D.Q 6．对于T触发器，若原态Qn=1，欲使新态Qn+1=1，应使输入T= 。 A.0 B.1 C.Q D.Q 7．对于D触发器，欲使Qn+1=Qn，应使输入D= 。 A.0 B.1 C.Q D.Q 8．对于JK触发器，若J=K，则可完成触发器的逻辑功能。 A.RS B.D C.T D.Tˊ 9．欲使JK触发器按Qn+1=Qn工作，可使JK触发器的输入端。 A.J=K=0 B.J=Q,K=Q C.J=Q,K=Q D.J=Q,K=0 E.J=0,K=Q 10．欲使JK触发器按Qn+1=Q n工作，可使JK触发器的输入端。 A.J=K=1 B.J=Q,K=Q C.J=Q,K=Q D.J=Q,K=1 E.J=1,K=Q 11．欲使JK触发器按Qn+1=0工作，可使JK触发器的输入端。 A.J=K=1 B.J=Q,K=Q C.J=Q,K=1 D.J=0,K=1 E.J=K=1 12．欲使JK触发器按Qn+1=1工作，可使JK触发器的输入端。 A.J=K=1 B.J=1,K=0 C.J=K=Q D.J=K=0 E.J=Q,K=0 13．欲使D触发器按Qn+1=Q n工作，应使输入D= 。 A.0 B.1 C.Q D.Q 14．下列触发器中，克服了空翻现象的有。 A.边沿D触发器 B.主从RS触发器 C.同步RS触发器 D.主从JK触发器 15．下列触发器中，没有约束条件的是。 A.基本RS触发器 B.主从RS触发器 C.同步RS触发器 D.边沿D触发器 16．描述触发器的逻辑功能的方法有。

SQL触发器实例讲解

SQL触发器实例讲解 SQL 资料2009-07-23 14:44:07 阅读6072 评论9 字号：大中小订阅定义：何为触发器？在SQL Serv er里面也就是对某一个表的一定的操作，触发某种条件，从而执行的一段程序。触发器是一个特殊的存储过程。常见的触发器有三种：分别应用于Insert , Update , Delete 事件。我为什么要使用触发器？比如，这么两个表： Create Table Student( --学生表 StudentID int primary key, --学号 .... ) Create Table BorrowRecord( --学生借书记录表 BorrowRecord int identity(1,1), --流水号 StudentID int , --学号 BorrowDate datetime, --借出时间 ReturnDAte Datetime, --归还时间 ... ) 用到的功能有: 1.如果我更改了学生的学号,我希望他的借书记录仍然与这个学生相关(也就是同时更改借书记录表的学号); 2.如果该学生已经毕业，我希望删除他的学号的同时，也删除它的借书记录。等等。这时候可以用到触发器。对于1，创建一个Update触发器： Create Trigger truStudent On Student --在Student表中创建触发器 f or Update --为什么事件触发 As --事件触发后所要做的事情 if Update(StudentID) begin Update BorrowRecord Set StudentID=i.StudentID From BorrowRecord br , Deleted d ,Inserted i --Deleted和Inserted临时表 Where br.StudentID=d.StudentID end

数电实验触发器及其应用

数电实验触发器及其应用数字电子技术实验报告实验三: 触发器及其应用一、实验目的: 1、熟悉基本RS触发器，D触发器的功能测试。 2、了解触发器的两种触发方式（脉冲电平触发和脉冲边沿触发）及触发特点 3、熟悉触发器的实际应用。二、实验设备: 1 、数字电路实验箱; 2、数字双综示波器; 3、指示灯; 4、74LS00、74LS74。三、实验原理: 1、触发器是一个具有记忆功能的二进制信息存储器件，是构成多种时序电路的最基本逻辑单元，也是数字逻辑电路中一种重要的单元电路。在数字系统和计算机中有着广泛的应用。触发器具有两个稳定状态，即“0”和“ 1 ”，在一定的外界信号作用下，可以从一个稳定状态翻转到另一个稳定状态。触发器有集成触发器和门电路（主要是“与非门” ）组成的触发器。按其功能可分为有RS触发器、JK触发器、D触发器、T功能等触发器。触发方式有电平触发和边沿触发两种。 2、基本RS触发器是最基本的触发器，可由两个与非门交叉耦合构成。基本RS触发器具有置“ 0”、置“ 1”和“保持”三种功能。基本RS触发器

也可以用二个“或非门”组成，此时为高电平触发有效。 3、D触发器在CP的前沿发生翻转，触发器的次态取决于CP脉冲上升沿n+1来到之前D端的状态，即Q = D。因此，它具有置“ 0”和“T两种功能。由于在CP=1期间电路具有阻塞作用，在CP=1期间，D端数据结构变RS化，不会影响触发器的输出状态。和分别是置“ 0”端和置“ 1” DD 端，不需要强迫置“ 0”和置“ 1”时，都应是高电平。74LS74(CC4013, 74LS74(CC4042均为上升沿触发器。以下为74LS74的引脚图和逻辑图。馬LD 1CP 1云IQ LQ GM) 四、实验原理图和实验结果：设计实验： 1、一个水塔液位显示控制示意图，虚线表示水位。传感器A、B被水浸沿时

数字电子技术试卷试题答案汇总(完整版)

数字电子技术基础试题库及答案汇总一、填空题（每空1分，共20分） 1、逻辑代数中3种基本运算是，，。 2、逻辑代数中三个基本运算规则，，。 3、逻辑函数的化简有，两种方法。 4、A+B+C= 。 5、TTL 与非门的u I ≤U OFF 时，与非门，输出，u I ≥U ON 时，与非门，输出。 6、组合逻辑电路没有功能。 7、竞争冒险的判断方法，。 8、触发器它有稳态。主从RS 触发器的特性方程，主从JK 触发器的特性方程，D 触发器的特性方程。二、选择题（每题1分，共10分） 1、相同为“0”不同为“1”它的逻辑关系是（） A 、或逻辑 B 、与逻辑 C 、异或逻辑 2、Y （A ，B ，C ，）=∑m （0，1，2，3）逻辑函数的化简式（） A 、Y=AB+BC+ABC B 、Y=A+B C 、Y=A 3、 A 、Y=A B B 、Y 处于悬浮状态 C 、Y=B A + 4、下列图中的逻辑关系正确的是（） A.Y=B A + B.Y=B A + C.Y=AB 5、下列说法正确的是（） A 、主从JK 触发器没有空翻现象 B 、JK 之间有约束 C 、主从JK 触发器的特性方程是CP 上升沿有效。 6、下列说法正确的是（） A 、同步触发器没有空翻现象 B 、同步触发器能用于组成计数器、移位寄存器。 C 、同步触发器不能用于组成计数器、移位寄存器。 7、下列说法是正确的是（） A 、异步计数器的计数脉冲只加到部分触发器上 B 、异步计数器的计数脉冲同

时加到所有触发器上 C、异步计数器不需要计数脉冲的控制8、下列说法是正确的是（） A、施密特触发器的回差电压ΔU=U T+-U T- B、施密特触发器的回差电压越大，电路的抗干扰能力越弱 C、施密特触发器的回差电压越小，电路的抗干扰能力越强 9、下列说法正确的是（） A、多谐振荡器有两个稳态 B、多谐振荡器有一个稳态和一个暂稳态 C、多谐振荡器有两个暂稳态 10、下列说法正确的是（） A、555定时器在工作时清零端应接高电平 B、555定时器在工作时清零端应接低电平 C、555定时器没有清零端三、判断题（每题1分，共10分） 1、A+AB=A+B （） 2、当输入9个信号时，需要3位的二进制代码输出。（） 3、单稳态触发器它有一个稳态和一个暂稳态。（） 4、施密特触发器有两个稳态。（） 5、多谐振荡器有两个稳态。（） 6、D/A转换器是将模拟量转换成数字量。（） 7、A/D转换器是将数字量转换成模拟量。（） 8、主从JK触发器在CP=1期间，存在一次性变化。（） 9、主从RS触发器在CP=1期间，R、S之间不存在约束。（） 10、所有的触发器都存在空翻现象。（）四、化简逻辑函数（每题5分，共10分） 1、 2、Y（A，B，C，）=∑m（0，1，2，3，4，6，8，9，10，11，14）五、画波形图（每题5分，共10分） 1、 2、六、设计题（每题10分，共20分）

oracle-触发器练习

触发器课堂练习1 1、当向SC表插入数据时，修改（或添加）SC_NUMBER（包括学生学号和选课门数两列）表格中的数据。 create or replace trigger tr_sc_AR_I after insert on sc for each row begin update sc_number set scnum=scnum+1where sno=:new.sno; if sql%notfound then insert into sc_number values(:new.sno,1); end if; end; 测试结果： 2、当删除SC表中数据时，修改（或添加）SC_NUMBER中的数据。 create or replace trigger tr_sc_AR_D after delete on sc for each row begin update sc_number set scnum=scnum-1where sno=:old.sno; select scnum into pk_trigger.tr_scnum from sc_number where sno=:old.sno; if(pk_trigger.tr_scnum=0) then

delete from sc_number where sno=:old.sno; end if; end; 测试结果： 3、当修改SC表中数据时，若修改的是学号，则对应修改SC_NUMBER表中的选课门数，否则打印“某某（学生）的学生选课信息已经修改”信息。 create or replace trigger tr_sc_AR_U after update on sc for each row

第6章_存储过程与触发器练习题

有教师表(教师号，教师名，职称，基本工资)，其中基本工资的取值与教师职称有关。实现这个约束的可行方案是( )。 A 在教师表上定义一个视图 B 在教师表上定义一个存储过程 C 在教师表上定义插入和修改操作的触发器 D 在教师表上定义一个标量函数参考答案 C 在SQL SERVER中，执行带参数的过程，正确的方法为（）。 A 过程名参数 B 过程名（参数） C 过程名=参数 D ABC均可参考答案 A 在SQL SERVER服务器上，存储过程是一组预先定义并（）的Transact-SQL语句。 A 保存 B 解释 C 编译 D 编写参考答案 C 在SQL Server中，触发器不具有（）类型。 A INSERT触发器 B UPDATE触发器 C DELETE触发器 D SELECT触发器参考答案 D

（）允许用户定义一组操作，这些操作通过对指定的表进行删除、插入和更新命令来执行或触发。 A 存储过程 B 规则 C 触发器 D 索引参考答案 C 为了使用输出参数，需要在CREATE PROCEDURE语句中指定关键字( )。 A OPTION B OUTPUT C CHECK D DEFAULT 参考答案 B 下列( )语句用于创建触发器。 A CREATE PROCEDURE B CREATE TRIGGER C ALTER TRIGGER D DROP TRIGGER 参考答案 B 下列( )语句用于删除触发器。 A CREATE PROCEDURE B CREATE TRIGGER C ALTER TRIGGER D DROP TRIGGER 参考答案 D

触发器及其应用实验报告 - 图文-

实验报告一、实验目的和任务 1. 掌握基本RS、JK、T和D触发器的逻辑功能。 2. 掌握集成触发器的功能和使用方法。 3. 熟悉触发器之间相互转换的方法。二、实验原理介绍触发器是能够存储1位二进制码的逻辑电路,它有两个互补输出端,其输出状态不仅与输入有关,而且还与原先的输出状态有关。触发器有两个稳定状态,用以表示逻辑状态"1"和"0飞在二定的外界信号作用下,可以从一个稳定状态翻转到另一个稳定状态,它是一个具有记忆功能的二进制信息存储器件,是构成各种时序电路的最基本逻辑单元。 1、基本RS触发器图14-1为由两个与非门交叉祸合构成的基本RS触发器,它是无时钟控制低电平直接触发的触发器。基本RS触发器具有置"0"、置"1"和保持三种功能。通常称s为置"1"端,因为 s=0时触发器被置"1"; R为置"0"端,因为R=0时触发器被置"0"。当S=R=1时状态保持,当S=R=0时为不定状态,应当避免这种状态。

基本RS触发器也可以用两个"或非门"组成,此时为高电平有效。 S Q S Q Q 卫R Q (a(b 图14-1 二与非门组成的基本RS触发器 (a逻辑图(b逻辑符号基本RS触发器的逻辑符号见图14-1(b,二输入端的边框外侧都画有小圆圈,这是因为置1与置。都是低电平有效。 2、JK触发器在输入信号为双端的情况下,JK触发器是功能完善、使用灵活和通用性较强的一种触发器。本实验采用74LS112双JK触发器,是下降边沿触发的边沿触发器。引脚逻辑图如图14-2所示;JK触发器的状态方程为: Q,,+1=J Q"+K Q 3 5

J Q CLK K B Q 图14-2JK触发器的引脚逻辑图其中,J和IK是数据输入端,是触发器状态更新的依据,若J、K有两个或两个以上输入端时,组成"与"的关系。Q和Q为两个互补输入端。通常把Q=O、Q=1的状态定为触发器"0"状态;而把Q=l,Q=0 定为"}"状态。 JK触发器常被用作缓冲存储器,移位寄存器和计数器。 CC4027是CMOS双JK触发器,其功能与74LS112相同,但采用上升沿触发,R、S端为高电平

数字电路触发器试卷练习题

2016学年德清职业中专《数字电路》第二次月考试卷第一学期（适用15计网3+2）班级：姓名: 得分：一、填空题：（30分） 1.触发器有两个输出端_______和________，正常工作时两端的状态互补，以_________端的状态表示触发器的状态。 2.按结构形式的不同，RS触发器可分为两大类：一类是没有时钟控制的____________触发器,另一类是具有时钟控制端的__________触发器。 3. 按逻辑功能划分，触发器可以分为________触发器、___________触发器、__________触发器和________触发器四种类型。 4.钟控触发器也称同步触发器，其状态的变化不仅取决于___________信号的变化，还取决于___________信号的作用。 5.钟控触发器按结构和触发方式分，有电位触发器、_________触发器、_________触发器和主从触发器四种类型。 6.各种时钟控触发器中不需具备时钟条件的输入信号是________和_______。二、选择题：（20分） 1.能够存储0、1 二进制信息的器件是（） A.TTL门 B.CMOS门 C.触发器 D.译码器 2.触发器是一种（）Ａ．单稳态电路Ｂ.无稳态电路Ｃ.双稳态电路Ｄ.三稳态电路3.用与非门构成的基本RS触发器处于置1 状态时，其输入信号R应为（） S、 A.00 R D. 11 S = = S R RＢ.01 = S = R C.10 S 4.用与非门构成的基本RS触发器，当输入信号S= 0、R= 1

时，其逻辑功能为( ) A.置1 B.置0 C.保持 D.不定 5.下列触发器中，输入信号直接控制输出状态的是（） A ．基本RS 触发器 B. 钟控RS 触发器 C. 主从JK 触发器 D. 维持阻塞D 触发器 6.具有直接复位端 d R 和置位端d S 的触发器，当触发器处于受 CP 脉冲控制的情况下工作时，这两端所加的信号为 ( ) A. 00d d =S R B. 01d d =S R C. 10d d =S R D. 11d d =S R 7.输入信号高电平有效的 RS 触发器中，不允许的输入是（） A.RS=00 B.RS=01 C.RS=10 D.RS=11 8.下列触发器中，具有置0、置1、保持、翻转功能的是( ) A. RS 触发器 B. D 触发器 C.JK 触发器 D. T 触发器 9.时钟触发器产生空翻现象的原因是因为采用了（） A.主从触发方式 B.上升沿触发方式 C.下降沿触发方式 D.点位触发方式 10.当输入J = K = 1时，JK 触发器所具有的功能是( ) A.置0 B.置1 C.保持 D.翻转三、画图题：（40分） 1. 如图，设Q 初始状态为0，画出Q 的波形(5分)

数字电子技术试卷试的题目答案详解汇总情况

数字电子技术基础试卷试题答案汇总一、填空题（每空1分，共20分） 1、逻辑代数中3种基本运算是（与运算、或运算、非运算） 2、逻辑代数中三个基本运算规则（代入规则、反演规则、对偶规则） 3、逻辑函数的化简有公式法，卡诺图两种方法。 4、A+B+C= A ’B ’C ’ 。 5、TTL 与非门的u I ≤U OFF 时，与非门关闭，输出高电平，u I ≥ U ON 时，与非门导通，输出低电平。 6、组合逻辑电路没有记忆功能。 7、竞争冒险的判断方法代数方法，卡诺图法。 8、触发器它2 稳态,主从RS 触发器的特性方程Q ’’=S+RQ ’ SR=0 ，主从JK 触发器的特性方Q ’’=JQ ’+K ’Q ，D 触发器的特性方程 Q ’’=D 。二、选择题（每题1分，共10分） 1、相同为“0”不同为“1”它的逻辑关系是（ C ） A 、或逻辑 B 、与逻辑 C 、异或逻辑 2、Y （A ，B ，C ，）=∑m （0，1，2，3）逻辑函数的化简式（ C ） A 、Y=AB+BC+ABC B 、Y=A+B C 、Y=A （A) 3、 A 、Y=A B B 、Y 处于悬浮状态 C 、Y=B A + 4、下列图中的逻辑关系正确的是（ A ） A.Y=B A + B.Y=B A + C.Y=AB 5、下列说法正确的是（ A ）

A、主从JK触发器没有空翻现象 B、JK之间有约束 C、主从JK触发器的特性方程是CP上升沿有效。 6、下列说法正确的是（ C ） A、同步触发器没有空翻现象 B、同步触发器能用于组成计数器、移位寄存器。 C、同步触发器不能用于组成计数器、移位寄存器。 7、下列说法是正确的是（ A ） A、异步计数器的计数脉冲只加到部分触发器上 B、异步计数器的计数脉冲同时加到所有触发器上 C、异步计数器不需要计数脉冲的控制 8、下列说法是正确的是（A ） A、施密特触发器的回差电压ΔU=U T+-U T- B、施密特触发器的回差电压越大，电路的抗干扰能力越弱 C、施密特触发器的回差电压越小，电路的抗干扰能力越强 9、下列说法正确的是（ C ） A、多谐振荡器有两个稳态 B、多谐振荡器有一个稳态和一个暂稳态 C、多谐振荡器有两个暂稳态 10、下列说法正确的是（ A ） A、555定时器在工作时清零端应接高电平 B、555定时器在工作时清零端应接低电平 C、555定时器没有清零端三、判断题（每题1分，共10分） 1、A+AB=A+B （错） 2、当输入9个信号时，需要3位的二进制代码输出。（错） 3、单稳态触发器它有一个稳态和一个暂稳态。（对） 4、施密特触发器有两个稳态。（对） 5、多谐振荡器有两个稳态。（错） 6、D/A转换器是将模拟量转换成数字量。（错） 7、A/D转换器是将数字量转换成模拟量。（错） 8、主从JK触发器在CP=1期间，存在一次性变化。（对） 9、主从RS触发器在CP=1期间，R、S之间不存在约束。（错） 10、所有的触发器都存在空翻现象。（错）

触发器实验报告

触发器实验报告集团标准化工作小组 #Q8QGGQT-GX8G08Q8-GNQGJ8-MHHGN#

实验报告课程名称：数字电子技术基础实验指导老师：周箭成绩：__________________ 实验名称：集成触发器应用实验类型：同组学生姓名：__邓江毅_____ 一、实验目的和要求（必填）二、实验内容和原理（必填）三、主要仪器设备（必填）四、操作方法和实验步骤五、实验数据记录和处理六、实验结果与分析（必填）七、讨论、心得实验内容和原理 1、D →J-K 的转换实验设计过程：J-K 触发器和D 触发器的次态方程如下： J-K 触发器：n n 1+n Q Q J =Q K +， D 触发器：Qn+1=D 若将D 触发器转换为J-K 触发器，则有：n n Q Q J =D K +。实验结果： J K Qn-1 Qn 功能 0 0 0 0 保持 1 1 0 1 0 0 置0 1 0 1 1 0 1 翻转 1 0 1 0 1 置1 1 1 实验截图：专业：电卓1501 姓名：卢倚平学号：日期：地点：东三404

（上：Qn ，下：CP ，J 为高电平时） 2、D 触发器转换为T ’触发器实验设计过程：D 触发器和T ’触发器的次态方程如下： D 触发器：Q n+1= D ， T ’触发器：Q n+1=!Q n 若将D 触发器转换为T ’触发器，则二者的次态方程须相等，因此有：D=!Qn 。实验截图： (上：Qn ，下：!Qn ）CP 为1024Hz 的脉冲。 3、J-K →D 的转换实验。 ①设计过程： J-K 触发器：n n 1+n Q Q J =Q K ， D 触发器：Qn+1=D 若将J-K 触发器转换为D 触发器，则二者的次态方程须相等，因此有：J=D ，K=!D 。实验截图：

集成触发器试卷

集成触发器姓名：号数： 1.是非题（对的打?，错的打?）（1）触发器的逻辑特性与门电路一样，输出状态仅取决于触发器的即时输入状（）（2）时钟脉冲的主要作用是使触发器的输出状态稳定。……………………..（）（3）基本RS触发器的S D、R D信号不受时钟脉冲的控制，就能将触发器置1或置0……………………………………………………………………….（）（4）主从RS触发器能够避免触发器空翻现象。……………………..（）（5）主从触发器电路中主触发器和从触发器输出状态的翻转是同时进行的。（）（6）同步触发器只有在ＣＰ信号到来后，才依据Ｒ、Ｓ信号的变化来改变输出的状态。……………………………………………………………..（）２. 选择题（１）基本RS触发器电路中，触发脉冲消失后，其输出状态（）。Ａ、恢复原状态Ｂ、保持现状态Ｃ、出现新状态（２）基本RS触发器完成转换所需的时间为（）Ａ、ｔｐｄＢ、２ｔｐｄＣ、４ｔｐｄ（3）为了提高抗干扰能力，触发器脉冲宽度是（） A、越宽越好 B、越窄月好 C、无关的（4）触发器与组合逻辑门电路比较（） A、两者都有记忆能力 B、只有组合逻辑门电路记忆能力 B、只有触发器记忆能力（5）从触发器的工作特点看，它是（） A、双稳态电路 B、单稳态电路 C、无稳态电路 3. 填空题（1）触发器具有个稳定状态，（2）同步RS触发器状态的改变是与信号同步的。（3）主从触发器是一种能防止现象的实用触发器。（4）触发器电路中，S D、R D端可以根据需要预先将触发器或，而不受的同步控制。（5）与非门构成的基本RS触发器，当S = 0，R = 1时，其输出状态是。（6）在时钟脉冲控制下，根据输入信号及J端、K端的不同情况，能够具有、、和功能的电路，称为JK触发器。 4. 问答题及画图题（1）触发器的基本性质是怎样的触发器按逻辑功能之不同有哪些基本类型

触发器练习题

一、判断题 1、用逻辑门构成的各种触发器均属于电平异步时序逻辑电路（） 2、RS、JK、D和T四种触发器中，唯有RS触发器存在输入信号的约束条件（） 3、与非门的输入端加有低电平时，其输出端恒为高电平。（） 4、数字电路可以分为组合逻辑电路和时序逻辑电路两大类。（） 5、时序逻辑电路中存在反馈，其输出不仅取决于当时的输入，还与电路的上一个状态有关。（） 6、组合逻辑电路的输出只与当时的输入有关，与电路的上一个状态无关，没有记忆功能。（） 7、触发器是时序逻辑电路的基本单元。（） 8、时序逻辑电路由组合逻辑电路和存储电路构成。（） 9、触发器的反转条件是由触发输入与时钟脉冲共同决定的。（） 10、组合逻辑电路任何时刻的输出不仅与该时刻的输入状态有关，还与先前的输出状态有关。（） 11、译码器、比较器属于组合逻辑电路。 12、数字电路可分为组合逻辑电路和时序逻辑电路。 13、全加器是实现两个1位二进制数相加并考虑低位进位的逻辑电路。 14、实现同一逻辑功能的逻辑电路可以不同 15、译码是编码的逆过程。 16、寻找组合逻辑电路输入输出关系表达式的过程和方法,是组合逻辑电路的设计过程. 17、公式化简法有时不容易判断结果是否最简. 18、实现同一逻辑功能的电路是唯一的. 19、加法器可以有并行进位加法器. 20、七段显示译码器有共阳极和共阴极显示器两种接法. 21、一个班级有80个学生，现采用二进制编码器对每位学生进行编码，则编码器输出至少5位二进制数才能满足要求 22、高电平有效的显示译码器可驱动共阴极接法的数码管 23、低电平有效的显示译码器可驱动共阳极接法的数码管 24、高电平有效的显示译码器可驱动共阳极接法的数码管 25、低电平有效的显示译码器可驱动共阴极接法的数码管 26、同一CP控制各触发器的计数器称为异步计数器（） 27、各触发器的信号来源不同的计数器称为同步计数器（） 28、1个触发器可以存放2个二进制数（） 29、D触发器只有时钟脉冲上升沿有效的品种。 30、同步RS触发器用在开关去抖中得到应用。 31、不同触发器间的逻辑功能是可以相互转换的。 32、对边沿JK触发器，在CP为高电平期间，当J=K=1时，状态会翻转一次。（） 33、JK触发器只要J，K端同时为1，则一定引起状态翻转。( ) 34、将D触发器的端与D端连接就可构成T'触发器。( ) Q35、JK触发器在CP作用下，若J=K=1，其状态保持不变。( ) 36、JK触发器在CP作用下，若J=K=1，其状态变反。 ( ) 37、使，就可实现JK触发器到D触发器的功能转换。( ) D?JK?38、JK触发器在CP作用下，若J=K=0，其状态保持不变。 ( ) ( ) 。（即复位）0，则触发器置J=K=0作用下，若CP触发器在39JK． 40、D触发器的特性方程为Qn+1=D，与Qn无关，所以它没有记忆功能。( )

D触发器及其应用实验报告

实验五D触发器及其应用实验人员：班号：学号：一、实验目的 1、熟悉D触发器的逻辑功能； 2、掌握用D触发器构成分频器的方法； 3、掌握简单时序逻辑电路的设计二、实验设备 74LS00 ，74LS74，数字电路实验箱，数字双踪示波器，函数信号发生器三、实验内容 1、用74LS74（1片）构成二分频器、四分频器，并用示波器观察波形； 74LS74是双D触发器（上升沿触发的边沿D触发器），其管脚图如下：其功能表如下： ○1构成二分频器：用一片74LS74即可构成二分频器。实验电路图如下：

○2构成四分频器：需要用到两片74LS74。实验电路图如下： 2、实现如图所示时序脉冲（用74LS74和74LS00各1片来实现）将欲实现功能列出真值表如下：

Q 1n+1=Q 0n =D 1 Q 0n+1=Q 1n ????=D 0 F ′=Q 1n Q 0n ???? F =F ′?CP 连接电路图如下：四、实验结果 1、用74LS74（1片）构成二分频器、四分频器。示波器显示波形如下： ○ 1二分频器： ○ 2四分频器：

2、实现时序脉冲。示波器显示波形如下：五、故障排除在做“用74LS74（1片）构成二分频器、四分频器”时，连接上示波器后，发现通道二总显示的是类似于电容放电的波形，但表现出了二分频。反复排查问题均没有发现原因。最后换了一根连接示波器的线，便得到了理想的结果。在示波器使用时想要用U盘保存电路波形，不会操作。后来在询问了同学之后才知道只需要按“print”就好。六、心得体会通过此次实验，我更深入地领悟了触发器的原理和用法，还复习了示波器的用法，还学会了如何保存示波器波形。

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