简易DDS频率合成器设计

目录

第一章系统分析与设计方案 (1)

1.1 DDS设计原理介绍 (1)

1.2直接数字式频率合成器(DDS)的基本结构 (1)

1.3基本DDS结构的常用参量计算 (1)

1.3.1 DDS的输出频率f out 。 (1)

1.3.2 DDS产生的相位。 (1)

1.3.3 DDS的频率分辨率。 (1)

1.3.4 DDS的频率输入字FW计算。 (2)

1.4 DDS的工作原理 (2)

1.4.1相位累加器与频率控制字FW (2)

1.4.2 相位控制字PW (2)

第二章软件设计 (3)

2.1 Verilog HDL程序 (3)

2.1.1 8位加法器程序代码 (3)

2.1.2 16位加法器程序代码 (3)

2.1.3 8位寄存器程序代码 (3)

2.1.4 16位寄存器程序代码 (4)

2.1.5 dds代码程序 (4)

2.1.6 ROM的创建 (4)

第三章实验仿真 (5)

3.1 原理图 (5)

3.1.1 ROM (5)

3.1.2 八位加法器 (5)

3.1.3 十六位加法器 (5)

3.1.4 八位寄存器 (6)

3.1.5 十六位寄存器 (6)

3.2 仿真波形 (6)

3.3 D/A转换电路 (9)

3.3.1 DAC0832结构及工作原理 (9)

3.3.2 D/A转换电路模块 (10)

3.4 实验结果 (10)

3.5 调试过程 (10)

3.5.1对adder8、adder16、reg8、reg16的调试 (10)

3.5.2. D/A转换电路的调试 (10)

3.5.3．输出波形的调试 (10)

第四章心得体会 (11)

第五章参考文献 (12)

第一章系统分析与设计方案

1.1 DDS设计原理介绍

DDS即Direct Digital Synthesizer数字频率合成器，是一种基于全数字技术，从相位概念出发直接合成所需波形的一种频率合成技术，是一种新型的数字频率合成技术。具有相对带宽大、频率转换时间短、分辨力高、相位连续性好等优点，很容易实现频率、相位和幅度的数控调制，广泛应用于通讯领域。

1.2直接数字式频率合成器(DDS)的基本结构

直接数字式频率合成器（DDS）是从相位概念出发直接合成所需波形。其电路一般包括基准时钟、频率累加器、相位累加器、相位调制器、同步寄存器、正弦ROM查找表，D/A转换器。基本结构如图1所示。

图1 直接数字式频率合成器(DDS)的基本结构

1.3基本DDS结构的常用参量计算

1.3.1 DDS的输出频率f out 。

F out=(FW×f clk)/ 2N

f clk1=50KHZ，FW=1，n=8,则F out =195.3125HZ。

f clk1=500KHZ，FW=1，n=8,则F out =1.953KHZ。

1.3.2 DDS产生的相位。

（PW×2π）/2N

1.3.3 DDS的频率分辨率。

F out=f clk/2N

1.3.4 DDS的频率输入字FW计算。

FW=2N×（f out/f clk）

1.4 DDS的工作原理

1.4.1相位累加器与频率控制字FW

每来一个时钟脉冲f clk，N位加法器将频率控制字FW与累加寄存器输出的累加相位数据相加，把相加后的结果送至累加寄存器的输入端。累加寄存器一方面将在上一时钟周期作用后所产生的新的相位数据反馈到加法器的输入端，使加法器在下一时钟的作用下继续与频率控制字FW相加；另一方面将该值作为存储器的地址输出相应的波形数据。最终经D/A转换成所需要的模拟波形。相位累加器在基准时钟的作用下，进行线性相位累加，当相位累加器加满量时就会产生一次溢出，这样就完成了一个周期，此周期即为DDS 的频率周期。DDS的输出信号频率：F out=(F W×f clk)/ 2N，通过设定相位累加器的位数和频率控制字可确定输出频率。

1.4.2 相位控制字PW

每来一个时钟脉冲f clk，加法器将相位控制器PW与累加寄存器输出的数据相加，把相加后的结果作为波形存储器（ROM）的相位取样地址，这样就可以把存储在波形存储器内的波形取样值（二进制编码）经查找表查出，完成相位到幅值转换。波形存储器的输出送到D/A转换器，将数字量转换成所要求合成频率的模拟量信号。

第二章软件设计2.1 Verilog HDL程序

2.1.1 8位加法器程序代码

module adder8(sum,a,b);

output sum;

input a,b;

wire[3:0] a;

wire[3:0] b;

wire[7:0] sum;

assign sum=a+b;

end module

2.1.2 16位加法器程序代码

module adder16(sum,a,b);

output sum;

input a,b;

wire[7:0] a;

wire[7:0] b;

wire[15:0] sum;

assign sum=a+b;

endmodule

2.1.3 8位寄存器程序代码

module reg8(din, q, clk);

output[7:0] q;

input[7:0] din, input, clk;

reg[7:0] q;

always @(posedge clk) begin

q=din;

end

endmodule

2.1.4 16位寄存器程序代码

module reg16(din,q,clk);

output[15:0]q;

input[15:0]din;

input clk;

reg[15:0]q;

always @(posedge clk) begin

q=din;

end

endmodule

2.1.5 dds代码程序

module dds (clk0,fword,pword,fout,pout);

output[7:0] fout,pout;

input[7:0] fword,pword;

input clk0;

wire[7:0] lin8b,sin8b;

wire[15:0] f16b,d16b,din16b;

assign f16b[15:8]=fword;

assign f16b[7:0]=8'b00000000;

adder16 u1(.a(f16b),.b(d16b),.sum(din16b));

reg16 u2( clk(clk0),.in(din16b),.qout(d16b));

rom u3(d16b[15:8],fout);

adder8 u4(.a(pword),.b(d16b[15:8]),.sum(lin8b));

reg8 u5(.clk(clk0),.in(lin8b),.qout(sin8b));

rom u6(sin8b,pout);

endmodule

2.1.6 ROM的创建

首先选择ROM数据文件编辑窗，即在File菜单中选择“New”，并在New窗中选择“Other files”项，并选“Memory Initialization File”，点击OK后产生ROM数据文件大小选择窗。这里采用2点8位数据的情况，可选ROM的数据数Number为256，数据宽Word size取8位。点击“OK”，将出现空的mif数据表格，表格中的数据为10进制表达方式，任一数据对应的地址为左列于顶行数之和）。将波形数据填入此表中，完成后在File菜单中点击“Save as”，保存此数据文件。

第三章实验仿真3.1 原理图

3.1.1 ROM

ROM深度256，数据位8位如图2所示

图2 ROM深度256，数据位8位3.1.2 八位加法器

图3 八位加法器

3.1.3 十六位加法器

图4 十六位加法器

3.1.4 八位寄存器

图5八位寄存器3.1.5 十六位寄存器

图6十六位寄存器3.2 仿真波形

adder8波形如图3所示

图7 adder8波形adder16波形如图4所示

图8 adder16波形

reg8波形如如图5所示

图9 reg8波形reg16波形如图6所示

图10 reg16波形rom波形如如图7所示

图11 rom波形ddsf1p0波形如如图8所示

图12 ddsf1p0波形ddsf2p0波形如如图9所示

图13 ddsf2p0波形

ddsf8p0波形如如图10所示

图14 ddsf8p0波形ddsf32p0波形如如图11所示

图15 ddsf32p0波形ddsf1p64波形如如图12所示

图12 ddsf1p64波形ddsf1p128波形如如图13所示

图13 ddsf1p128波形

ddsf1p192波形如如图14所示

图14 ddsf1p192波形

3.3 D/A转换电路

图15 DAC0830引脚图图16 DAC0832的逻辑结构

3.3.1 DAC0832结构及工作原理

DAC0832是8分辨率的D/A转换集成芯片。这个DA芯片以其价格低廉、接口简单、转换控制容易等优点，在电子产品中得到广泛的应用。D/A转换器由8位输入锁存器、8位DAC寄存器、8位D/A转换电路及转换控制电路构成。引脚图及主要内部逻辑结构图15、16所示。根据对DAC0832的数据锁存器和DAC 寄存器的不同的控制方式，DAC0832有三种工作方式：直通方式、单缓冲方式和双缓冲方式。DAC0832是采用CMOS工艺制成的单片直流输出型8位数/模转换器。如图4-82所示，它由倒T型R-2R电阻网络、模拟开关、运算放大器和参考电压VREF四大部分组成。，输出的模拟量与输入的数字量成正比，这就实现了从数字量到模拟量的转换。

一个8位D/A转换器有8个输入端（其中每个输入端是8位二进制数的一位），有一个模拟输出端。输入可有28=256个不同的二进制组态，输出为256个电压之一，即输出电压不是整个电压范围内任意值，而只能是256个可能值。

3.3.2 D/A转换电路模块

ROM中存储数据，采用查表法输出的数字信号经过D/A转换器DAC0832和OP07转换和运放后产生0V 到5V之间范围的电压范围。

3.4 实验结果

实验数据如表1所示

表1 实验结果表格

3.5 调试过程

3.5.1对adder8、adder16、reg8、reg16的调试

对这4个部分的调整主要针对仿真波形的参数设定，加法器的end time设定为20us,寄存器设定为10us。且各个仿真波形的时钟要设定统一。且这4个波形的输入变量都设置为10进制，结果便于观察，以上仿真图都验证了结果的正确性。

3.5.2. D/A转换电路的调试

其中接电源时用到了+12V、12V，所以对应管脚一定检查清楚，还有最后测输出电压时，DAC0832的数据端都置高时，V out=5V，当只有最高位接地时V out=2.5V。

3.5.3．输出波形的调试

在接开发板之前要做fword,pword，fout,pout的引脚锁定及器件选择。然后做仿真波形，仿真波形无误后再将示波器的输入接上图电路板的输出。观察示波器输出的正弦波形。

第四章心得体会

通过此次系统课程设计的学习，掌握了很多EDA课程内容与实际应用结合的知识。这一点也是感触最深的一点，刚开始学习EDA，感觉非常摸不到学习的门路，即使认真听老师讲课了，仍然还是觉得这些新的知识非常难以理解，以前都没有接触过的；但是通过没星期这样长时间系统的实验，觉得知识不是简单的浮于课本上，对EDA课程的认识也变得越来越透明。尤其是对Quartus软件的使用，比之前掌握的更加熟练。软件使用过程中生成模块的不同方法，以及使用过程中该注意的方法都慢慢掌握。

同时在做的过程中发现自己很多的问题，尤其是小细节方面，试验过程中自己出现的问题比如有：刚开始用软件的时候总是忘了先建一个工程，以至于自己的工程下很多文件也显得很凌乱，刚开始居然以为同一顶层文件下的不同模块是在不同的工程内，所以导致编译出错；在编写程序的时候字母的大小写没有注意，但错过一次之后就不会再犯这种错误了。还有程序或原理图都弄好后要整体编译；再仿真波形的时候一定要使时钟保持一致，各参数也选择好。

第五章参考文献

1.蒋立平编著.《数字电路》.南京理工大学出版社

2.南京理工大学电子技术中心编.《EDA设计实验指导书》

3.付文红、花汉兵编著.《EDA技术与实验》.机械工业出版社

4.王毅评、张振荣编著.《VHDL编程与仿真》.北京人民邮电出版社

5.潘松、黄继业编著.《EDA技术实用教程》.北京科学出版社

6.邹彦编著.《EDA技术与数字系统设计》.北京电子工业出版社

7.谭会生、瞿遂春等编.《EDA技术综合应用实例与分析》.西安电子科技大学出版社

实现直接数字频率合成器的三种技术方案

实现直接数字频率合成器的三种技术方 案 [日期：2004-12-7] 来源：电子技术应用作者：杭州商学院信息 与电子工程学院姜田华 [字体：大中 小] 摘要：讨论了DDS的工作原理及性能性点，介绍了目前实现DDS常用的三种技术方案，并对各方案的特点作了简单的说明。 关键词：直接数字频率合成器相位累加器信号源现场可编程门限列 1971年，美国学者J.Tierney等人撰写的“A Digital Frequency Synthesizer”-文首次提出了以全数字技术，从相位概念出发直接合成所需波形的一种新给成原理。限于当时的技术和器件产，它的性牟指标尚不能与已有的技术盯比，故未受到重视。近1年间，随着微电子技术的迅速发展，直接数字频率合成器（Direct Digital Frequency Synthesis简称DDS或DDFS）得到了飞速的发展，它以有别于其它频率合成方法的优越性能和特点成为现代频率合成技术中的姣姣者。具体体现在相对带宽宽、频率转换时间短、频率分辨率高、输出相位连续、可产生宽带正交信号及其他多种调制信号、可编程和全数字化、控制灵活方便等方面，并具有极高的性价比。 1 DDS基本原理及性能特点 DDS的基本大批量是利用采样定量，通过查表法产生波形。DDS的结构有很多种，其基本的电路原理可用图1来表示。 相位累加器由N位加法器与N位累加寄存器级联构成。每来一个时钟脉冲fs，加法器将控制字 k与累加寄存器输出的累加相位数据相加，把相加后的结果送到累加寄存器的数据输入端，以使加法器在下一个时钟脉冲的作用下继续与频率控制字相加。这样，相位累加器在时钟作用下，不断对频率控制字进行线性相位加累加。由此可以看出，相位累加器在每一个中输入时，把频率控制字累加一次，相位累加器输出的数据就是合成信号的相位，相位累加器的出频率就是DDS输出的信号频率。 用相位累加器输出的数据作为波形存储器（ROM）的相位取样地址。这样就可把存储在波形存储器内的波形抽样值（二进制编码）经查找表查出，完成相位到幅值转换。波形存储器的输出送到D/A转换器，D/A转换器将数字量形式的波形幅值转换成所要求合成频率的模拟量形式信号。低通滤波器用于滤除不需要的取样分量，以便输出频谱纯净的正弦波信号。

频率合成器设计报告

频率合成器课程设计 总结报告 指导教师：曹俊友 组员：李刚、魏虹宇、张朋、蒙荣鸿 专业：电子信息科学与技术092 日期： 2012年1月1日

摘要：本设计是关于锁相环频率合成器的设计，设计主要由电源、自制压控振荡器（VCO）、锁相环频率合成器（PLL）、单片机控制（MCU）显示以及键盘操作五部分组成。电源部分采用稳压芯片获得稳定的3.3V以及5V的电压输出，压控振荡器采用MAX2620芯片外接电感电容并联谐振回路制成，锁相环频率合成器采用ADF4106制成，、采用AT89C52单片机作为系统的控制单元。基本要求：输出频率可改变，输出功率可调整。扩展要求：具有显示功能，具有键盘控制功能。 关键词：锁相环（PLL）、压控振荡器（VCO）、环路滤波（LPF）、单片机（MCU） Abstract：This design is about lock cirtle frequency synthesizer design, design mainly by power supply, self-control voltage control oscillation (VCO), and phase lock loop (PLL) frequency synthesizer and single-chip microcomputer control (MCU) display and keyboard five parts. The power supply voltage of the chip made steady 3.3 V and 5 V voltage output, controlled oscillator MAX2620 adopts chip made, lock cirtle frequency synthesizer made by ADF4106, by AT89C52 single chip microcomputer as system, the control unit. Basic requirements: output frequency can change, output power can be adjusted. Expand requirements: display function with the keyboard control function. Key words:Phase lock loop (PLL)、Voltage control oscillation (VCO)、LPF、SCM (MCU)

基于FPGA的直接数字频率合成器设计

1 JANGSU UNIVERSITY OF TECHNOLOGY FPGA技术实验报告基于FPGA的直接数字频率合成器设计 学院：电气信息工程学院 专业：电子信息工程 班级： 姓名： 学号： 指导教师：戴霞娟、陈海忠 时间: 2015.9.24

1 目录 绪论.......................................................................................... 错误！未定义书签。 一、背景与意义 (2) 二、设计要求与整体设计 (2) 2.1 设计要求 (2) 2.2 数字信号发生器的系统组成 (3) 2.3 DDS技术 (3) 三、硬件电路设计及原理分析 (4) 3.1 硬件电路设计图 (4) 3.2 设计原理 (5) 四、程序模块设计、仿真结果及分析 (5) 4.1顶层模块设计 (6) 4.2分频模块设计 (6) 4.3时钟模块设计 (11) 4.4数据选择模块设计 (12) 4.5正弦波产生模块设计........................................................ 错误！未定义书签。 4.6三角波产生模块设计 (15) 4.7方波产生模块设计............................................................ 错误！未定义书签。 4.8锯齿波模块设计 (18) 五、软硬件调试 (21) 5.1正弦波 (22) 5.2锯齿波 (22) 5.3方波 (23) 5.4三角 (23) 六、调试结果说明及故障分析 (24) 七、心得体会 (24) 八、参考文献 (25) 九、附录 (25)

数字频率合成器的外文翻译

英文原文 Modulating Direct Digital Synthesizer In the pursuit of more complex phase continuous modulation techniques, the control of the output waveform becomes increasingly more difficult with analog circuitry. In these designs, using a non-linear digital design eliminates the need for circuit board adjustments over yield and temperature. A digital design that meets these goals is a Direct Digital Synthesizer DDS. A DDS system simply takes a constant reference clock input and divides it down a to a specified output frequency digitally quantized or sampled at the reference clock frequency. This form of frequency control makes DDS systems ideal for systems that require precise frequency sweeps such as radar chirps or fast frequency hoppers. With control of the frequency output derived from the digital input word, DDS systems can be used as a PLL allowing precise frequency changes phase continuously. As will be shown, DDS systems can also be designed to control the phase of the output carrier using a digital phase word input. With digital control over the carrier phase, a high spectral density phase modulated carrier can easily be generated. This article is intended to give the reader a basic understanding of a DDS design, and an understanding of the spurious output response. This article will also present a sample design running at 45MHz in a high speed field programmable gate array from QuickLogic. A basic DDS system consists of a numerically controlled oscillator (NCO) used to generate the output carrier wave, and a digital to analog converter (DAC) used to take the digital sinusoidal word from the NCO and generate a sampled analog carrier. Since the DAC output is sampled at the reference clock frequency, a wave form smoothing low pass filter is typically used to eliminate alias components. Figure 1 is a basic block diagram of a typical DDS system design.The generation of the output carrier from the reference sample clock input is performed by the NCO. The basic components of the NCO are a phase accumulator and a sinusoidal ROM lookup table. An optional phase modulator can also be include in the NCO design. This phase modulator will add phase offset to the output of the phase accumulator just before the ROM lookup table. This will enhance the DDS system design by adding the

频率合成器的设计

前言 频率合成器是现代无线通信设备中一个重要的组成部分，直接影响着无线通信设备的性能。频率合成技术历经了早期的直接合成技术（DS）和锁相合成技术（PLL），发展到如今的直接数字合成技术（DDS）。直接数字合成技术具有分辨率高，转换速度快，相位噪声低等优点，在无线通信中发挥着越来越重要的作用。随着大规模集成电路的发展，利用锁相环频率合成技术研制出了很多频率合成集成电路。频率合成器是电子系统的心脏，是决定电子系统性能的关键设备，随着通信、数字电视、卫星定位、航空航天、雷达和电子对抗等技术的发展，对频率合成器提出了越来越高的要求。频率合成技术是将一个或多个高稳定、高精确度的标准频率经过一定变换，产生同样高稳定度和精确度的大量离散频率的技术。频率合成理论自20世纪30年代提出以来，已取得了迅速的发展，逐渐形成了目前的4种技术：直接频率合成技术、锁相频率合成技术、直接数字式频率合成技术和混合式频率合成技术。 本文是以如何设计一个锁相环频率合成器为重点，对频率合成器做了一下概述，主要介绍了锁相环这一部分，同时也对锁相环频率合成器的设计及调试等方面进行了阐述。

1 总体方案设计 实现频率合成的方法有多种，可用直接合成，锁相环式，而锁相环式的实现方法又有多种，例如可变晶振，也可变分频系数M，还可以用单片机来实现等等。下面列出了几种用锁相法实现频率合成的方案。 1.1方案一 图1.1 方案一原理框图 如图1.1所示，在VCO的输出端和鉴相器的输入端之间的反馈回路中加入了一个÷N的可变分频器。高稳定度的参考振荡器信号fR经R次分频后，得到频率为fr的参考脉冲信号。同时，压控振荡器的输出经N次分频后，得到频率为fd的脉冲信号，两个脉冲信号在鉴频鉴相器进行频率或相位比较。当环路处于锁定状态时，输出信号频率：fo=N*fd。只要改变分频比N，即可实现输出不同频率的fo，从而实现由fr合成fo的目的。其输出频率点间隔Δf＝fr。 1.2方案二

直接数字频率合成器DDS研究设计毕业论文

直接数字频率合成器DDS研究设计毕业论文 目录 1. 引言 (1) 1.1 频率合成器的研究背景 (1) 1.2频率合成器的研究现状 (1) 2. 频率合成技术 (3) 2.1频率合成技术概述 (3) 2.2频率合成器的主要指标 (3) 2.3频率合成的基本方法 (5) 2.4 频率合成器的长期频率稳定度和相位噪声 (5) 2.4.1长期频率稳定度 (5) 2.4.2 相位噪声 (6) 2.4.3噪声来源 (7) 3. 直接频率合成（DS）技术 (8) 3.1 直接频率合成器的基本原理和组成 (8) 3.2直接频率合成器的几个主要组成电路 (9) 3.2.1混频器 (9) 3.2.2倍频器 (11) 3.2.3分频器 (12) 3.2.5石英晶体振荡器 (14) 4. 直接数字频率合成(DDS)技术 (17) 4.1 直接数字频率合成的组成及其特点 (17) 4.2 直接数字频率合成的基本原理 (19) 4.3 直接数字频率合成的相位噪声和杂散 (20) 4.3.1 直接数字频率合成的相位噪声 (20) 4.3.2 直接数字频率合成的杂散分析 (21) 4.3.3 降低杂散电平的方法 (21) 4.4 集成直接数字频率合成器的芯片介绍 (23) 5. 直接数字频率合成器的设计 (26) 5.1 DDS芯片在跳频系统中应用的总体框图 (26)

5.2 控制模块 (26) 5.2.1 AT89C51引脚说明 (26) 5.2.2 单片机外围电路设计 (28) 5.3 频率合成模块 (29) 5.3.1 AD9852的引脚说明 (29) 5.4电平转换模块 (32) 5.5低通滤波模块 (33) 5.6 放大电路 (35) 结束语 (36) 致谢 (37) 参考文献 (38)

直接数字式频率合成器

实验八 直接数字式频率合成器（DDS ）程序设计与仿真实验 1 实验目的 (1) 学习利用EDA 技术和FPGA 实现直接数字频率合成器的设计。 (2) 掌握使用Quartus Ⅱ原理图输入设计程序。 2 实验仪器 （1）GW48系列SOPC/EDA 实验开发系统 （2）配套计算机及Quartus II 软件 3 实验原理 直接数字频率合成技术，即DDS 技术，是一种新型的频率合成技术和信号产生方法。其电路系统具有较高的频率分辨率，可以实现快速的频率切换，并且在改变时能够保持相位的连续，很容易实现频率、相位和幅度的数控调制。 传统的生成正弦波的数字是利用—片ROM 和一片DAC ，再加上地址发生计数器和寄存器即可。在ROM 中，每个地址对应的单元中的内容(数据)都相应于正弦波的离散采样值，ROM 中必须包含完整的正弦波采样值，而且还要注意避免在按地址读取ROM 内容时可能引起的不连续点，避免量化噪音集中于基频的谐波上。时钟频率f clk 输入地址发生计数器和寄存器，地址计数器所选中的ROM 地址的内容被锁入寄存器，寄存器的输出经DAC 恢复成连续信号，即由各个台阶重构的正弦波，若相位精度n 比较大，则重构的正弦波经适当平滑后失真很小。当f clk 发生改变，则DAC 输出的正弦波频率就随之改变，但输出频率的改变仅决定于f clk 的改变。 为了控制输出频率更加方便，可以采用相位累加器，使输出频率正比于时钟频率和相位增量之积。图1所示为采用了相位累加方法的直接数字合成系统，把正弦波在相位上的精度定为n 位，于是分辨率相当于1／2n 。用时钟频率f P 依次读取数字相位圆周上各点，这里数字值作为地址，读出相应的ROM 中的值(正弦波的幅度)，然后经DAC 重构正弦波。这里多了一个相位累加器，它的作用是在读取数字相位圆周上各点时可以每隔M 个点读一个数值，M 即力图1中的频率字。这样，DAC 输出的正弦波频率f sin 就等于“基频” f clk 1／2n 的M 倍，即DAC 输出的正弦波的频率满足下式： )2(sin n clk f M f (1) 这里，f clk 是DDS 系统的工作时钟，式(6-1-1)中的n 通常取值在24~32之间，由图1可知，

直接数字频率合成知识点汇总(原理_组成_优缺点_实现)

直接数字频率合成知识点汇总（原理_组成_优缺点_实现） 直接数字频率合概述DDS同DSP（数字信号处理）一样，也是一项关键的数字化技术。DDS是直接数字式频率合成器（Direct Digital Synthesizer）的英文缩写。DDS 是从相位概念出发直接合成所需要波形的一种新的频率合成技术。 直接数字频率合成是一种新的频率合成技术和信号产生的方法，具有超高速的频率转换时间、极高的频率分辨率分辨率和较低的相位噪声，在频率改变与调频时，DDS能够保持相位的连续，因此很容易实现频率、相位和幅度调制。此外，DDS技术大部分是基于数字电路技术的，具有可编程控制的突出优点。因此，这种信号产生技术得到了越来越广泛的应用，很多厂家已经生产出了DDS专用芯片，这种器件成为当今电子系统及设各中频率源的首选器件。 直接数字频率合成原理工作过程为： 1、将存于数表中的数字波形，经数模转换器D/A，形成模拟量波形。 2、两种方法可以改变输出信号的频率： （1）改变查表寻址的时钟CLOCK的频率，可以改变输出波形的频率。 （2）、改变寻址的步长来改变输出信号的频率.DDS即采用此法。步长即为对数字波形查表的相位增量。由累加器对相位增量进行累加，累加器的值作为查表地址。 3、D/A输出的阶梯形波形，经低通（带通）滤波，成为质量符合需要的模拟波形。 直接数字频率合成系统的构成直接数字频率合成主要由标准参考频率源、相位累加器、波形存储器、数/模转换器、低通平滑滤波器等构成。其中，参考频率源一般是一个高稳定度的晶体振荡器，其输出信号用于DDS中各部件同步工作。DDS的实质是对相位进行可控等间隔的采样。 直接数字频率合成优缺点优点：（1）输出频率相对带宽较宽 输出频率带宽为50%fs（理论值）。但考虑到低通滤波器的特性和设计难度以及对输出信号杂散的抑制，实际的输出频率带宽仍能达到40%fs。 （2）频率转换时间短

锁相环CD4046设计频率合成器

通信专业课程设计——基于锁相环的频率合成器的设计 设 计 报 告 姓名：曾明 班级：通信工程2班 学号：2008550725 指导老师：粟建新

目录 一、设计和制作任务 (3) 二、主要技术指标 (3) 三、确定电路组成方案 (3) 四、设计方法 (4) （一）、振荡源的设计 (4) （二）、N分频的设计 (4) （三）、1KHZ标准信号源设计（即M分频的设计） (5) 五、锁相环参数设计 (6) 六、电路板制作 (7) 七、调试步骤 (8) 八、实验小结 (8) 九、心得体会 (9) 十、参考文献 (9) 附录：各芯片的管脚图 (10)

锁相环CD4046设计频率合成器 内容摘要： 频率合成是以一个或少量的高准确度和高稳定度的标准频率作为参考频率，由此导出多个或大量的输出频率，这些输出的准确度与稳定度与参考频率是一致的。在通信、雷达、测控、仪器表等电子系统中有广泛的应用， 频率合成器有直接式频率合成器、直接数字式频率合成器及锁相频率合成器三种基本模式，前两种属于开环系统，因此是有频率转换时间短，分辨率较高等优点，而锁相频率合成器是一种闭环系统，其频率转换时间和分辨率均不如前两种好，但其结构简单，成本低。并且输出频率的准确度不逊色与前两种，因此采用锁相频率合成。 关键词：频率合成器CD4046 一、设计和制作任务 1．确定电路形式，画出电路图。 2．计算电路元件参数并选取元件。 3．组装焊接电路。 4．调试并测量电路性能。 5．写出课程设计报告书 二、主要技术指标 1．频率步进 1kHz 2．频率稳定度f ≤1KHz 3．电源电压 Vcc=5V 三、确定电路组成方案 原理框图如下，锁相环路对稳定度的参考振动器锁定，环内串接可编程的分频器，通过改变分频器的分配比N，从而就得到N倍参考频率的稳定输出。 晶体振荡器输出的信号频率f1， 经固定分频后（M分频）得到 基准频率f1’，输入锁相环的相 位比较器（PC）。锁相环的VCO

DDS 直接数字频率合成器 实验报告(DOC)

直接数字频率合成器（DDS） 实验报告 课程名称电类综合实验 实验名称直接数字频率合成器设计 实验日期2015.6.1—2013.6.4 学生专业测试计量技术及仪器 学生学号114101002268 学生姓名陈静 实验室名称基础实验楼237 教师姓名花汉兵 成绩

摘要 直接数字频率合成器（Direct Digital Frequency Synthesizer 简称DDFS 或DDS）是一种基于全数字技术，从相位概念出发直接合成所需波形的一种频率合成技术。本篇报告主要介绍设计完成直接数字频率合成器DDS的过程。其输出频率及相位均可控制，且能输出正弦波、余弦波、方波、锯齿波等五种波形，经过转换后在示波器上显示。经控制能够实现保持、清零功能。除此之外，还能同时显示出频率控制字、相位控制字和输出频率的值。实验要求分析整个电路的工作原理，并分别说明了各子模块的设计原理，依据各模块之间的逻辑关系，将各电路整合到一块，形成一个总体电路。本实验在Quartus Ⅱ环境下进行设计，并下载到SmartSOPC实验系统中进行硬件测试。最终对实验结果进行分析并总结出在实验过程中出现的问题以及提出解决方案。 关键词：Quartus Ⅱ直接数字频率合成器波形频率相位调节 Abstract The Direct Digital Frequency Synthesizer is a technology based on fully digital technique, a frequency combination technique syntheses a required waveform from concept of phase. This report introduces the design to the completion of the process of direct digital frequency synthesizer DDS. The output frequency and phase can be controlled, and can output sine, cosine, triangle wave, square wave, sawtooth wave, which are displayed on the oscilloscope after conversation. Can be achieved by the control to maintain clear function. Further can simultaneously display the value of the frequency, the phase control word and the output frequency. The experimental design in the Quartus Ⅱenvironment, the last hardware test download to SmartSOPC experimental system. The final results will be analyzed, the matter will be put forward and the settling plan can be given at last. Key words:Quartus ⅡDirect Digital Frequency Synthesizer waveform Frequency and phase adjustment

数字PPL频率合成器的原理与使用

龙源期刊网 https://www.wendangku.net/doc/c51357056.html, 数字PPL频率合成器的原理与使用 作者：伊力多斯·艾尔肯 来源：《中国科技博览》2013年第36期 中图分类号：TN742.1 文献标识码：A 文章编号：1009-914X（2013）36-0323-01 中波广播发射机载波频率振荡器能在531KHZ--1602KH频段内提供，1KHZ为间隔的1071个频率点。这些频点的载波振荡频率稳定度和精度都应满足系统的性能要求，并能迅速变换。显然常用的晶体振荡器无法满足上述要求，因为尽管晶体振荡器能提供高稳定的振荡频率，但其频率值单一，只能在很小的频率段内进行微调。频率合成技术则是能够实现上述要求的一种新技术，数字PLL频率合成器是目前应用最广泛的一种频率合成器，它与模拟PLL频率合成器的区别在于数字PLL中采用除法器（分频器），而不是用频率减法器来降低输入鉴相器频 率的。由于分频器可以很方便的用数字电路来实现，而且还具有可储存可变换的功能。因此它比一般的模拟PLL频率合成器更方便、更灵活。此外，数字电路易于集成和超小型化。 PLL即相位锁定环路，它是自动控制两振荡信号频率相等和相位同步的闭环系统，频率合成是指用可变分频器的方法将一个（或多个）基准频率信号转换为频率按比例降低或升高的另一个（或多个）所需频率信号的技术，采用PLL技术的频率合成器称为锁相环路频率合成 器，图（1）所示为数字PLL合成器的原理框图。它主要有鉴相器（PD），压控振荡器（VCO），基准晶体振荡器，基准分频器（1/R），前置分频器（1/K），可编程分频器也叫程控分频器（1/N），低通滤波器（LPF）等组成。可编程分频器的分频系数N由二进制码Po---Pn制定（如图1）。 其中鉴相器（PD）是完成压控振荡器（VCO）的输出信号U0（t），经前置分频和程控分频的信号Uf（T）与输入信号Ui（t）的相位比较，得到误差相位Φe（t）=Φf（t）-Φi（t），产生一个输出电压Ud（t），这个电压的大小直接反映两个信号相位差的大小，电压的极性反应输入信号Ui（t）超前或滞后于Uf（t）的相对相位关系。由此可见，PD在环路中是用来完成相位差电压转换作用，其输出误差电压是瞬间相位的函数。低通滤波器（LPF）滤除Ud （t）中的高频分量与噪声成分，得到控制信号Uc（t），压控振荡器（VCO）受Uc（t）控

24GHz射频前端频率合成器设计

第48卷第1期（总第187期） 2019年3月 火控雷达技术 Fire Control Ｒadar Technology Vol.48No.1（Series 187） Mar.2019 收稿日期：2018-10-24作者简介：饶睿楠（1977－），男，高级工程师。研究方向为频率综合器及微波电路技术。 24GHz 射频前端频率合成器设计 饶睿楠 王 栋 余铁军 唐 尧 （西安电子工程研究所西安710100） 摘要：随着微波射频集成电路集成度越来越高， 24GHz 频段的高集成雷达收发芯片逐渐大规模使用。其中英飞凌科技公司的24GHz 锗硅工艺高集成单片雷达解决方案就是其中具有代表性的一种，被大量应用在液位或物料检测、照明控制、汽车防撞、安防系统。FMCW 为此种应用最多采用的信号调制方式。本文采用锁相环频率合成方案，产生系统所需的FMCW 调制信号。关键词：24GHz 射频前端；FMCW ；频率综合器BGT24AT2ADF4159中图分类号：TN95文献标志码：A 文章编号：1008－8652（2019）01－066－04 引用格式：饶睿楠，王栋，余铁军，唐尧．24GHz 射频前端频率合成器设计［ J ］．火控雷达技术，2019，48（1）：66－69． DOI ：10．19472/j．cnki．1008－8652．2019．01．014 Design of a Frequency Synthesizer for 24GHz ＲF Front Ends Ｒao Ｒuinan ，Wang Dong ，Yu Tiejun ，Tang Yao （Xi'an Electronic Engineering Ｒesearch Institute ，Xi'an 710100） Abstract ：With the increasing integration of microwave and radio-frequency integrated circuits ，highly integrated radar transceiver chips in 24GHz band have gradually found large-scale applications．Among those chips ，Infineon's 24GHz SiGe monolithic radar solution is a typical one．It has found wide applications in liquid （or material ）detec-tion ，lighting control ，automotive collision avoidance ，and security systems．FMCW is the most widely used signal modulation method in these applications．This paper uses PLL frequency synthesis scheme to generate FMCW mod-ulation signals required by the system． Keywords ：24GHz ＲF front end ；FMCW ；frequency synthesizer ；BGT24AT2；ADF4159 0引言 24GHz 频段雷达大量用于液位检测、照明控制、汽车防撞、安防等领域。近年来由于微波集成电路的高速发展，单芯片电路集成度越来越高，出现了一大批高集成、多功能的射频微波集成电路，以前需要几片或十几片芯片的电路被集成在一片集成电路之中。英飞凌公司推出的基于锗硅工艺的高集成单片雷达解决方案就是其中对具代表性的产品之一。FMCW 信号调制方式被广泛的应用于此类产品。本文采用英飞凌公司BGT24AT2单片信号源芯片与ADI 公司ADF4159锁相环芯片构成24GHz 射频前端频率合成器部分，产生了24GHz 24．2GHz FM-CW 发射信号。 1BGT24AT2锗硅24GHz MMIC 信号源芯片基本指标 BGT24AT2是一款低噪声24GHz ISM 波段多功能信号源。内部集成24GHzVCO 和分频器。3路独立的ＲF 输出可分别输出+10dBm 的信号，通过SPI 可对输出信号功率进行控制。发射信号的快速脉冲和相位反向可通过单独的输入引脚或通用的SPI 控制接口进行控制。片内集成输出功率及温度传感器，可对芯片工作情况进行监控。芯片工作的环境温度为－40? 125?，满足汽车级环境应用要求。封装为32脚VQFN 封装，单3．3V 电源供电，节省了大量板上空间。其原理框图如图1所示。

直接数字频率合成器开题报告

毕业设计（论文）开题报告 题目基于FPGA的直接数字频率合成 专业名称通信工程 班级学号09042138 学生姓名周忠 指导教师刘敏 填表日期2013 年 1 月8 日

一、选题的依据及意义： 直接数字频率合成器（Direct Digital Frequency Synthesizer）是一种基于全数字技术，从相位概念出发直接合成所需波形的一种频率合成技术。其电路系统具有较高的频率分辨率，可以实现快速的频率切换（<20ns）,频率分辨率高（0.01HZ）,频率稳定度高，输出信号的频率和相位可以快速程控切换，输出相位可连续，可编程以及灵活性大等优点。DDS技术很容易实现频率、相位和幅度的数控调制，广泛用于接收本振、信号发生器、仪器、通信系统、雷达系统等，尤其适合调频无线通信系统 本课题使用可编程器件实现直接数字频率合成设计，它比传统的数字频率合成方式有着显著的优越性，与传统的频率合成器相比，DDS具有低成本、低功耗、高分辨率和快速转换时间等优点，广泛使用在电信与电子仪器领域，是实现设备全数字化的一个关键技术。 二、国内外研究概况及发展趋势（含文献综述）： 直接数字频率合成(DDS)技术是第三代频率合成技术。20世纪70年代以来，随着数字集成电路和电子技术的发展，出现了一种新的合成方法——直接数字频率合成。它从相位的概念出发进行频率合成，采用了数字采样存储技术，具有精确的相位，频率分辨率，快速的转换时间等突出优点，是频率合成技术的新一代技术。直接数字频率合成作为新一代数字频率技术发展迅速，并显示了很大的优越性，已经在军事和民用领域得到广泛的应用，例如在雷达（捷变频雷达、有源相控雷达、低截获概率雷达）、通信（跳频通信、扩频通信）、电子对抗（干扰和反干扰）、仪器和仪表（各种合成信号源）、任意波形发生器、产品测试、冲击和振动、医学等方面的应用。 DDS技术作为一项具有广泛前景和生命力的频率合成技术，越来越受到人们的重视。随着微电子技术的飞速发展，国外一些大公司Qualcomm、ADI等竞相推出DDS芯片，来满足设计人员的要求。许多性能优良的DDS产品不断的推向市场。 Qualcomm公司推出了DDS系列Q2220Q2230等其中Q2368的时钟频率

DDS直接数字合成信号源

目录 1 前言 (1) 2 总体方案比较与论证 (2) 3 系统工作原理 (3) 3.1 频率合成技术 (3) 3.2 DDS工作原理 (3) 3.2.1相位累加器 (4) 3.2.2波形存储器 (4) 4 单元模块设计与仿真 (5) 4.1累加器模块 (6) 4.2波形存储器模块 (7) 4.3相位调制模块 (8) 4.4滤波电路模块 (9) 5 芯片介绍 (10) 5.1FLEX6016结构及作用 (10) 6 总结与体会 (11) 7 致谢 (12) 8 参考文献 (13) 9 附录 (14) 附录一、Quartus II仿真原理图 (14) 附录二、单元模块Verilog HDL代码 (15)

1 前言 DDS技术是一种把一系列数字量形式的信号通过DAC转换成模拟量形式的信号的合成技术，它是将输出波形的一个完整的周期、幅度值都顺序地存放在波形存储器中，通过控制相位增量产生频率、相位可控制的波形。DDS电路一般包括基准时钟、相位增量寄存器、相位累加器、波形存储器、D/A转换器和低通滤波器（LPF）等模块。 相位增量寄存器寄存频率控制数据，相位累加器完成相位累加的功能，波形存储器存储波形数据的单周期幅值数据，D/A转换器将数字量形式的波形幅值数据转化为所要求合成频率的模拟量形式信号，低通滤波器滤除谐波分量。 整个系统在统一的时钟下工作，从而保证所合成信号的精确。每来一个时钟脉冲，相位增量寄存器频率控制数据与累加寄存器的累加相位数据相加，把相加后的结果送至累加寄存器的数据输出端。这样，相位累加器在参考时钟的作用下，进行线性相位累加，当相位累加器累加满量时就会产生一次溢出，完成一个周期性的动作，这个周期就是DDS合成信号的一个频率周期，累加器的溢出频率就是DDS输出的信号频率。 DDS有如下优点： 频率分辨率高，输出频点多，可达N个频点(N为相位累加器位数)； 频率切换速度快，可达us量级； 频率切换时相位连续； 可以输出宽带正交信号； 输出相位噪声低，对参考频率源的相位噪声有改善作用； 可以产生任意波形； 全数字化实现，便于集成，体积小，重量轻。 在各行各业的测试应用中，信号源扮演着极为重要的作用。但信号源具有许多不同的类型，不同类型的信号源在功能和特性上各不相同，分别适用于许多不同的应用。目前，最常见的信号源类型包括任意波形发生器，函数发生器，RF信号源，以及基本的模拟输出模块。信号源中采用DDS技术在当前的测试测量行业已经逐渐称为一种主流的做法。

频率合成器的设计与制作

频率合成器的设计与制作 这次课程设计的主要内容是频率合成器的设计与制作，首先了解什么是频率合成器。它有哪几个部分组成，哪些参数对它的技术指标有影响，然后是选择元器件，搭试电路，排版安装，测试数据，分析结果。 随着通信、雷达、宇航和遥控遥测技术的不断发展，对频率源的频率稳定度、频谱纯度、频率范围和输出频率的个数提出越来越高的要求。为了提高频率稳定度，经常采用晶体振荡器等方法来解决，但它不能满足频率个数多的要求，因此，目前大量采用频率合成技术。 频率合成器：通过对频率进行加、减、乘、除的运算，可从一个高稳定度和高准确度的标准频率源，产生大量的具有同一稳定度和准确度的不同频率。 频率合成的方法很多，大致可分为直接合成法和间接合成法俩种。直接合成法是通过倍频器、分频器、混频器对频率进行加、减、乘、除运算，得到各种所需频率。直接合成法的优点是频率转换时间短，并能产生任意小的频率增量。但它也存在一些不可克服的缺点，用这种方法合成的频率范围将受到限制。更重要的是由于大量的倍频，混频等电路，就要有不少滤波电路，使合成器的设备十分复杂，而且输出端的谐波、噪声及寄生频率难以抑制。而间接合成法就是利用锁相环路的窄带跟踪特性来得到不同的频率。频率合成器是从一个或多个参考频率中产生多种频率的器件。它在信息通信方面得到了广泛的应用，并有新的发展。

频率合成器的核心组成是锁相环路（PLL）。锁相的意义是一种相位负反馈控制系统，它利用相位的稳定来实现频率锁定，即“锁相”。控制电路是利用反馈原理实现对自身的调节与控制。AGC、AFC、PLL 分别对交流信号的三个参数振幅、频率、相位进行自动控制。能够完成两个电信号相位同步的自动控制闭环系统叫做锁相环，简称PLL。实现锁相的方法称为“锁相技术”。锁相环路广泛应用于广播通信、频率合成、自动控制及时钟同步等技术领域。 这里首先对锁相环路作一个简单介绍。 9.1 锁相环路的基本组成及工作原理 9.1.1 锁相环路的基本组成 锁相环路的基本组成框图如图9.1.1所示。 锁相环主要由鉴相器（PD）、环路滤波器（LF）和压控振荡器（VCO）三部分组成，其中，PD和LF构成反馈控制器，而VCO就是它的控制对象。 鉴相器（PD）实现相位差——电压的转换。将鉴相器替代AFC 系统中的鉴频器就得到锁相环路的方框图。 鉴相器（鉴相器）（PD）、压控振荡器（VCO）。低通滤波器三部分组成，如图1所示。 图1

第4章数字频率合成器的设计讲解

第4章数字频率合成器的设计 随着通信、雷达、宇航和遥控遥测技术的不断发展，对频率源的频率稳定度、频谱纯度、频率范围和输出频率的个数提出越来越高的要求。为了提高频率稳定度，经常采用晶体振荡器等方法来解决，但它不能满足频率个数多的要求，因此，目前大量采用频率合成技术。 频率合成是通信、测量系统中常用的一种技术,它是将一个或若干个高稳定度和高准确度的参考频率经过各种处理技术生成具有同样稳定度和准确度的大量离散频率的技术。频率合成的方法很多，可分为直接式频率合成器、间接式频率合成器、直接式数字频率合成器( DDS)。直接合成法是通过倍频器、分频器、混频器对频率进行加、减、乘、除运算，得到各种所需频率。该方法频率转换时间快(小于100ns)，但是体积大、功耗大，目前已基本不被采用。 锁相式频率合成器是利用锁相环（PLL）的窄带跟踪特性来得到不同的频率。该方法结构简化、便于集成，且频谱纯度高，目前使用比较广泛。 直接数字频率合成器（Direct Digital Frequency Synthesis简称：DDS）是一种全数字化的频率合成器，由相位累加器、波形ROM，D/A转换器和低通滤波器构成，DDS技术是一种新的频率合成方法，它具有频率分辨率高、频率切换速度快、频率切换时相位连续、输出相位噪声低和可以产生任意波形等优点。但合成信号频率较低、频谱不纯、输出杂散等。 这里将重点研究锁相式频率合成器。本章采用锁相环，进行频率

合成器的设计与制作。 4.1 设计任务与要求 1．设计任务：利用锁相环，进行频率合成器的设计与制作 2．设计指标： （1）要求频率合成器输出的频率范围f0为1kHz～99kHz； （2）频率间隔 f 为1kHz； （3）基准频率采用晶体振荡频率，要求用数字电路设计，频率稳定度应优于10－4； （4）数字显示频率； （5）频率调节采用计数方式。 3.设计要求： （1）要求设计出数字锁相式频率合成器的完整电路。 （2）数字锁相式频率合成器的各部分参数计算和器件选择。 （3）画出锁相式数字频率合成器的原理方框图、电路图 （4）数字锁相式频率合成器的仿真与调试。 4．制作要求： 自行装配和调试，并能发现问题解决问题。测试主要参数：包括晶体振荡器输出频率；1/M分频器输出频率；1/N可编程分频器的测试；锁相环的捕捉带和同步带测试。 5．课程设计报告要求。 写出设计与制作的全过程，附上有关资料和图纸，有心得体会。 6．答辩要求

直接数字频率合成器预习报告2012年版

预习报告 直接数字频率合成器（DDS）设计 指导老师﹕__________ 班级：___________ 姓名：___________ 学号：___________

直接数字频率合成器（Direct Digital Frequency Synthesizer）是一种基于全数字技术，从相位概念出发直接合成所需波形的一种频率合成技术。是一种新型的频率合成技术.具有相对带宽大,频率转换时间短,分辨力高,相位连续性好等优点,很容易实现频率,相位和幅度的数控调制,广泛应用于通讯领域.实验要求利

用QuartusII软件和SmartSOPC实验箱设计一个频率及相位均可控制的具有正弦和余弦输出的直接数字频率合成器（Direct Digital Frequency Synthesizer 简称DDFS或DDS）。 DDS主要由频率预置与调节电路、累加器、波形存储器、D/A转换器、低通滤波器构成。其组成原理如下图所示： 图2.1 DDS基本结构图 (1)频率预置与调节电路 作用：实现频率控制量的输入； 不变量K被称为相位增量，也叫频率控制字。频率控制字的值可以由EDA实验系统提供的若干个开关直接输入，也可以由一个外部开关控制计数器产生相应的频率控制字。 (2)累加器 图2.2 累加器原理图

累加器原理图如图2.2所示，它由N 位加法器N 位寄存器构成。每来一个时钟，加法器就将频率控制字K 与累加相位数据相加，相加的结果有反馈送至寄存器的数据输出端，以使加法器在下一个时钟脉冲的作用下继续与频率控制字相加。这样，相位相加器在每一个时脉冲输入时，把频率控制字累加一次，相位累加器的溢出频率就是DDS 输出的信号频率。由于相位累加器为N 位，相当于把正弦信号在相位上的精度定为N 位（N 的取值范围一般为24-32），所以分辨率为1/ 2N ，若系统基准时钟频率为c f ，频率控制字K 为1，则DDS 输出最小频率为o f =c f / 2N ；DDS 输出的最高频率由 Nyquist 采样定理决定，即c f /2（K 的最大值为2N-1）；若K 为B ，则输出频率为：o f =B ×c f / 2N 。 (3)波形存储器 图2.3 波形存储器 用相位累加器输出的数据作为波形存储器（ROM ）相位取样地址，这样就可把存储在波形存储器内的波形抽样值（二进制编码）经查找表查出，完成相位到幅值转换。N 位的寻址ROM 相当于把00~0360的正弦信号离散成具有2N 个样值的序列，若波形ROM 有D 位数据位，则2N 个样值的幅值以D 位二进制数值固化在ROM 中，按照地址的不同可以输出相应的正弦信号的幅值。 选取ROM 的地址（即相位累加器的输出数据）时，可以间隔选项，相位寄存器输出的位数N 一般取10-16位，这种载取方法称为截断式用法，以减少ROM